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VGOL 25 Pièces DIP16 IC 8BIT Registre à Décalage Entrée/Sortie Parallèle 16 Broches Ordinateur Dispositifs Trou Traversant SN74HC165N Noir pour Instruments D'équipement de Communication
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Les dispositifs SN74HC165N sont des registres à décalage à charge parallèle 8 bits qui, lorsqu'ils sont cadencés, décalent les données vers une sortie série (QH). l'accès parallèle à chaque étage est assuré par huit entrées de données directes individuelles (A-H) qui sont activées par un niveau bas au niveau de l'entrée de changement/chargement (SH/LD). Les appareils SN74HC165N disposent également d'une fonction d'inhibition d'horloge (CLK INH) et d'une sortie série complémentaire (QH). La synchronisation est réalisée par une transition de bas en haut de l'entrée d'horloge (CLK) tandis que SH/LD est maintenu haut et CLK INH est maintenu bas. Les fonctions de CLK et CLK INH sont interchangeables. Étant donné qu'un CLK faible et une transition de bas en haut de CLK INH effectuent également une synchronisation, CLK INH doit être modifié au niveau haut uniquement lorsque CLK est élevé. Le chargement parallèle est inhibé lorsque SH/LD est maintenu élevé. Lorsque SH/LD est faible, les entrées parallèles du registre sont activées indépendamment des niveaux des entrées CLK, CLK INH ou série (SER).
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Les dispositifs SN74HC165N sont des registres à décalage à charge parallèle 8 bits qui, lorsqu'ils sont cadencés, décalent les données vers une sortie série (QH). l'accès parallèle à chaque étage est assuré par huit entrées de données directes individuelles (A-H) qui sont activées par un niveau bas au niveau de l'entrée de changement/chargement (SH/LD). Les appareils SN74HC165N disposent également d'une fonction d'inhibition d'horloge (CLK INH) et d'une sortie série complémentaire (QH). La synchronisation est réalisée par une transition de bas en haut de l'entrée d'horloge (CLK) tandis que SH/LD est maintenu haut et CLK INH est maintenu bas. Les fonctions de CLK et CLK INH sont interchangeables. Étant donné qu'un CLK faible et une transition de bas en haut de CLK INH effectuent également une synchronisation, CLK INH doit être modifié au niveau haut uniquement lorsque CLK est élevé. Le chargement parallèle est inhibé lorsque SH/LD est maintenu élevé. Lorsque SH/LD est faible, les entrées parallèles du registre sont activées indépendamment des niveaux des entrées CLK, CLK INH ou série (SER).
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